Запоминающее устройство с самоконтролем

 

Изобретение относится к вычислительной технике, в частности к запоминающим устройствам. Целью изобретения является повышение надежности и быстродействия запоминающего устройства с самоконтролем . Устройство содержит накопитель 1, число адресов в котором превышает необходимое для работы вычислительного устройства , регистр 2 адреса, блоки 3 ввода информации, информационные регистры 7, 12, блоки 8 сравнения, триггеры 13, 14, элементы ИЛИ 15-19, элементы задержки 20- 23, элементы И 24-27, входы и выходы устройства. Устройство обеспечивает восстановление информации в определенном объеме , обладает высоким быстродействием, так как производятся всего две операции записи и считывания вместо трех, и высокой надежностью , -обусловленной уменьшением емкости накопителя. 1 ил., 2 табл. (Л со со

СОЮЗ СОВЕТСНИХ

СОЦИАЛИСТИЧЕСКИХ

РЕСПУБЛИН

„„SU„, 1297119

А1

Ш4 б 11 С 29/00

ОПИСАНИЕ ИЗОБРЕТЕНИЯ

Н А BTOPCHOMY СВИДЕТЕЛЬСТВУ

ГОСУДАРСТВЕННЫЙ КОМИТЕТ СССР

ПО ДЕЛАМ ИЗОБРЕТЕНИЙ И ОТНРЫТИЙ (21) 3962208/24-24 (22) 04.10.85 (46) 15.03.87. Бюл. № 10 (72) А. Г. Габсалямов, 3. Б. Шейдин и P. А. Лашевский (53) 681.327.6 (088.8) (56) Авторское свидетельство СССР № 951406, кл. G.11 С 29/00, 1980.

Авторское свидетельство СССР № 1188784, кл. G 11 С 11/00,,1983. (54) ЗАПОМИНАЮЩЕЕ УСТРОЙСТВО С

САМОКОНТРОЛЕМ (57) Изобретение относится к вычислительной технике, в частности к запоминающим устройствам. Целью изобретения является повышение надежности и быстродействия запоминающего устройства с самоконтролем. Устройство содержит накопитель

1, число адресов в котором превышает необходимое для работы вычислительного устройства, регистр 2 адреса, блоки 3 ввода информации, информационные регистры 7, 12, блоки 8 сравнения, триггеры 13, 14, элементы ИЛИ 15 — 19, элементы задержки 20—

23, элементы И 24 — 27, входы и выходы устройства. Устройство обеспечивает восстановление информации в определенном объеме, обладает высоким быстродействием, так как производятся всего две операции записи и считывания вместо трех, и высокой надежностью, обусловленной уменьшением емкости накопителя. 1 ил., 2 табл.

1297119

Изобретение относится к вычислительной технике, в частности к запоминающим устройствам.

Целью изобретения является повышение надежности и быстродействия запоминающего устройства с самоконтролем.

На чертеже изображена структурная схема запоминающего устройства с самоконтролем.

Устройство содержит накопитель 1, число адресов в котором в два раза превышает необходимое для работы вычислительного устройства, регистр 2 адреса, блоки 3 ввода информации, каждый из которых состоит из первого и второго элементов И 4 и

И 5 и элемента ИЛИ 6, первый информационный регистр 7, блоки 8 сравнения, каждый из которых состоит из элементов И—

НЕ 9, ИЛИ 10 и И 11, второй информационный регистр 12, первый триггер 13, второй триггер 14, первый 15, второй 16, третий 17, четвертый 18 и пятый 19 элементы ИЛИ, первый 20, второй 21, третий 22 и четвертый 23 элементы задержки, первый 24, второй 25, третий 26 и четвертый 27 элементы И. Устройство имеет адресные входы 28, входы 29 записываемого числа (информационные входы), входы

«Пуск«30, «Запись» 31 и считывание 32 (управляющие) устройства, информационные выходы 33 и выход «Разрешение считывания» 34.

Накопитель 1 имеет входы «Запись», «Пуск», «Считывание» и информационные выходы.

Устройство работает следующим образом.

На первый, второй и третий управляющие входы 30, 31, 32 устройства поступают соответственно сигналы «Пуск», «Запись» и «Считывание». На управляющем выходе 34 устройство вырабатывает сигнал

«Разрешено считывание».

Первый, второй, третий и четвертый элементы задержки 20, 21, 22 и 23 формируют соответственно сигналы «Пуск накопителя» и «Считывание», «Конец считывания», «Запись», «Окончание записи» и «Конец», которые подаются в накопитель 1 через его второй и третий управляющие входы.

При записи информации в накопитель 1 на входы 28 устройства поступает код адреса, по входам 29 — код записываемого числа, по входу 30 — сигнал «Пуск» и сигнал «Запись» по входу 31. Первый триггер 13 устанавливается пусковым сигналом через элемент ИЛИ 16 в состояние, соответствующее подключению первой половины накопителя . Второй триггер 14 через пятый элемент ИЛИ 9 устанавливается в положение «Считывание». Запись информации в регистр адреса происходит по переднему фронту сигнала «Пуск».

Записываемая информация через элементы И 5 и ИЛИ 6 блоков 3 ввода инфофрма ции поступает в первый информационный регистр 7.

На втором управляющем входе накопителя 1 через интервал времени, определяемый третьим элементом задержки 22 и третьим элементом ИЛИ 17, появляется сигнал

«Пуск». Одновременно сигнал поступает на вход четвертого элемента задержки 23 через пятый элемент ИЛИ 19. Информация из накопителя 1 поразрядно суммируется по модулю два с информацией из первого информационного регистра 7 посредством элементов И вЂ” HE 9, ИЛИ О, И 11 блоков сравнения 8 и поступает на входы второго информационного регистра 12, в который принимается по переднему фронту сигнала «Конец», поступающего с выхода четвертого элемента задержки 23. Сигнал «Конец считывания» с выхода первого элемента задержки 20 переводит первый триггер 13 в положение, соответствующее второй половине накопителя 1. Второй триггер 14 устанавливается в положение «Запись». Сигнал

«Пуск накопителя>: вырабатывается через третий элемент ИЛИ 17 и третий элемент задержки 22.

Информация из второго информационного регистра 12 записывается во вторую поло. вину накопителя 1.

5 !

О !

20

Второй триггер 14 устанавливается в положение «Считывание» по сигналу «Конец записи», поступающему через четвертый и пятый элементы ИЛИ 18, ИЛИ 19, а сигнал

«Пуск накопителя:> вырабатывается через перзый и третий элементы ИЛИ 15 и ИЛИ 17 и третий элемент задержки 22. Считывание информации из второго блока накопителя 1 выполняется аналогично считыванию из первой половины накопителя 1.

Сигнал «Конец считывания» вырабатывается первым элементом задержки 20 и поступает на счетный вход первого триггера 13 и переключает его ь состояние, соответствующее первой половине накопителя 1. Второй триггер 14 по сигналу, поступающему через первый элемент И 24, устанавливается в положение «Запись».

Запись информации в первую половину накопителя 1 выполняется аналогично записи во вторую половину накопителя l.

По сигналу «Конец записи» на выходе второго элемента задержки 21 через четвертый элемент ИЛИ 18 и четвертый элемент И

27 на выходе 34 вырабатывается сигнал

«Разрешено считывание»,которым заканчивается запись информации в накопитель 1.

В таблице приводятся возможные варианты результата записи информации, поступающей на вход 29 в зависимости от состояния- накопителя 1. Таблица 1 получена в предположении наличия только одного дефекта по двум разрядам одноименных адресов.

1297!19

При считывании информации на входы устройства поступает код адреса по входу 28, сигнал «Пуск» на вход 30, сигнал «Считывание» на вход 32. Первый триггер 13 через второй элемент ИЛИ 16 устанавливается в состояние, соответствующее первой половине накопителя 1. Второй триггер 14 через пятый элемент ИЛИ 19 устанавливается в положение «Считывание». Запись информации в регистр адреса происходит по переднему фронту сигнала «Пуск». На втором управляющем входе накопителя 1 появляется сигнал «Пуск накопителя» через интервал времени, определяемый третьим элементом задержки 22 и третьим элементом ИЛИ 17.

Информация из накопителя 1 поступает в первый информационный регистр 7 через элементы И 4 и ИЛИ 6 блока 3 ввода информации по переднему фронту сигнала

«Конец», поступающего с выхода четвертого элемента задержки 23 через третий элемент И 26 на вторые входы первых элементов И 4 блоков ввода информации.

Сигнал «Конец считывания» с выхода первого элемента задержки 20 переводит первый триггер 13 в положение, соответствующее подключению с второй половины накопителя 1. Сигнал на вход третьего эле- 2s мента задержки 22, на выходе которого вырабатывается сигнал «Пуск накопителя». потупает через второй элемент И 25, четвертый элемент ИЛИ 18, первый элемент ИЛИ

15 и третий элемент ИЛИ 17.

По переднему фронту сигнала «Конец», поступающего с выхода четвертого элемента задержки 28 во второй информационный регистр 12, принимается результат сравнения информации, считанной из второй половины накопителя 1 с информацией, хранившейся в первом информационном регистре 7 через элементы И вЂ” НЕ 9, ИЛИ 10 и И 11 блоков 8 сравнения. Сигнал «Разрешено считывание» на управляющем выходе 34 устройства вырабатывается через второй элемент И 25, четвертый элемент ИЛИ 18 и чет- 4р вертый элемент И 27 и позволяет следующему устройству системы принять истинную информацию для дальнейшей обработки.

В табл. 2 приводится результат считывания записанной информации при наличии дефектов, указанных в табл. 1, Сравнение записываемой на входах 29 информации и считываемой на выходах 33 показывает их полную идентичность.

Предлагаемое устройство обеспечивает восстановление информации в объеме, соответствующем устройству-прототипу. Однако предлагаемое устройство обладает более высоким быстродействием, так как требуются всего две операции записи или считывания вместо трех в устройстве-прототипе и более высокой надежностью, обусловленной уменьшением емкости накопителя и исключением блока мажорирования.

Формула изобретения

Запоминающее устройство с самоконтролем, содержащее накопитель, регистр адреса, информационные входы которого являются адресным входом устройства, а выходы соединены с адресными входами накопителя, элементы задержки, первый элемент И, первый элемент ИЛИ, первый вход которого и управляющий вход регистра адреса объединены и являются входом пуска устройства, отличающееся тем, что, с целью повышения надежности и быстродействия устройства, в него введены информационные регистры, блоки ввода информации, блоки сравнения, первый и второй триггеры, второй, третий, четвертый и пятый элементы

ИЛИ, второй, третий и четвертый элементы И, причем первые информационные входы блоков ввода информации, являются информационным входом устройства, а их выходы подключены к входам первого информационного регистра, выходы которого соединены с первыми информационными входами блоков сравнения, выходы которых подключены к информационным входам второго информационного регистра, выходы которого соединены с информационными входами накопителя, информационные выходы которого соединены с вторыми информационными входами блоков ввода информации и вторыми информационными входами блоков сравнения, выходы второго информационного регистра являются информационными выходами устройства, первые входы второго и пятого элементов ИЛИ подключены к входу пуска устройства, первый вход первого элемента И и первые управляющие входы блоков ввода информации объединены и являются входом записи устройства, первые входы второго и третьего элементов И объединены и являются входом считывания устройства, выход третьего элемента И подключен к вторым управляющим входам блоков ввода информации, выход первого элемен та ИЛИ соединен с первым входом третьего элемента ИЛИ и входом первого элемента задержки, выход которого соединен с вторым входом первого элемента И, вторым входом второго элемента И, вторым входом третьего элемента ИЛИ, первым входом первого триггера, выход которого подключен к входу записи накопителя, к первым входам третьего и четвертого элементов И, выход третьего элемента ИЛИ через третий элемент задержки подключен к входу обращения накопителя, выход первого элемента И соединен с первым входом второго триггера и через второй элемент задержки соединен с первым входом четвертого элемента ИЛИ, второй вход которого подключен к выходу второго элемента И, выход второго триггера подключен к входу считывания накопителя, выход четвертого

1297) 19 т а б г и ц а 1

Этапы

Выход накопителя

Вход накопителя

Выход накопителя

Записываемая информация на входах 29

Вход накопителя

0

0 — дефект второй половины накопителя, в остальных случаях предполагается дефект первой половины накопителя. т а б л н ц а 2 — — т

2 этап

Выход 33 устройства

Информация во второй половине

Информация в первой половине

1 этап

Записываемая информация на входах 29 выход блока 8 вход блока 8 накопителя накопителя

Составитель О. Кулаков

Редактор Н. Горват Техред И. Верее Корректор М. Самборская

Заказ 595/55 Тираж 590 Подписное

ВНИИПИ Государственного комитета СССР по делам изобретений и открытий

113035, Москва, Ж вЂ” 35, Раушская наб., д. 4/5

Производственно-полиграфическое предприятие, г. Ужгород, ул. Проектная, 4 элемента ИЛИ соединен с вторыми входами первого и пятого элементов ИЛИ и четвертого элемента И, выход которого является выходом разрешения счить|вания устройства, выход пятого элемента ИЛИ соединен с вторым входом второго триггера и через четвертый элемент задержки подключен к управляющему входу второго информационного регистра, к второму входу третьего элемента И, второму входу второго элемента ИЛИ, выход которого соединен с вторым входом первого триггера.