Микропрограммное устройство управления

 

ОПИСАНИЕ

ИЗОБРЕТЕНИЯ

К АВТОРСКОМУ СВИДЕТЕЛЬСТВУ

Союз Советских

Социалистических

Республик

t ai)3 005049 (б1) Дополнительное к авт. свид-ву (22) Заявлено 14 ° 07 ° 81(21) 3325537/18-24

f31) NLNn з с присоединением заявки HP

6 Об F 9/2?

Государственный комитет

СССР ио делан изобретений

: и открытий (23) Г1риоритет

Опубликовано 150383-Бюллетень ¹ 1о

Дата опубликования описания 150383 33) УАК б81. 325 (088.8) В.С. Харченко, В.A. Ìåëüíèêîâ, Г.H. Тимоньк ин и С.Н.Ткаченко (72) Авторы изобретения (71) Заявитель (54) МИКРОПРОГРАММНОЕ -УСТРОИСТВО УПРАВЛЕНИЯ

Изобретение относится к автоматике и вычислительной технике и может быть использовано в качестве многотактного устройства микропрограммно-. го управления при построении вычислительных машин и систем, а также

АСУ технологическими процессами.

Известно микропрограммное устройство управления, содержащее регистр адреса, блок памяти микропрограмм, регистр микрокоманд, дешнфраторы, блок управления .длительностью микропрограммного такта fl).

Недостатком данного устройства является его низкая надежность, обусловленная формированием окончания микротакта на секционных линиях задержки.

Наиболее близким к предлагаемому по технической сущности и достигаемому положительному эффекту является устройство, содержащее регистр адреса, последовательно соединенные генератор тактовых импульсов, блок выделения тактовых сигналов, последовательно соединенные первый дешифратор адреса, первый запоминающий блок, первый регистр микрокоманд, разделенный на и операционных полей и одно ад. ресное поле,а каждое иэ операционных полей содержит управляющую и информационные части, последовательно соециненные второй дешифратор адреса,вто" рой запоминающий блок.,второй регистр микрокоманд, содержащий адресное поле и и операционных полей,,и управляющих дешифраторов, первую группу блоков элементов И, первый блок элементов ИЛИ, вторую группу блоков эле" ментов И, первую группу блоков элементов ИЛИ, блок элементов 2 И - ИЛИ, и дешифраторов кодов операций, триг", гер управления (2) .

Недостатком этого устройства является низкое быстродействие, обусловленное использованием при многотактных микрокомандах микротактов постоянной длины независимо от тактов выдачи последней микрооперации.

Время выполнения микропрограммы, состоящей иэ 00 однотактных микроко" манд и N> многотактных микрокоманд рав но

Т1- й@Те+ М Тм йе Те+ mY@t4 где Т - дзтительность нанотактат ш - количество нанотактов в иикротакте.

Таким образом, прототип обладает большой временной избыточностью, ко"

1005049. торая обусловлена тем, что независимо от того, в каком нанотакте выдается последняя микрооперация в многотактной микрокоманде, время ее выполнения равно Т„ .

Цель изобретения — повышение быстродействия устройства.

Поставленная цель достигается тем, что в устройство, содержащее регистр адреса, генератор тактовых импульсов, Ччетчик, дешифратор, последовательно 10 соединенные первый дешифратор адреса, первый блок памяти, первый регистр микрокоманд, последовательно соединенные второй дешифратор адреса, второй блок памяти, второй ре-,15 гистр микрокоманд управляющих дешифраторов, первую группу блоков элементов И, первый блок элементов

ИЛИ, вторую группу блоков элементов

И, первую группу блоков элементов

ИЛИ, блок элементов 2И-ИЛИ, и дешифраторов кодов операций, триггер управления, причем выход регистра ад1

Ьеса соединен с информационными вхоами управляющих дешифраторов соответственно, выходы которых соедине «ы с первыми входами блоков элементов И первой группы, вторые входы которых соединены с выходом дешифратора, информационный вход которого соединен с выходом счетчика, счетный вход которо о подключен к выходу ге-. нератора тактовых импульсов и управляющему входу дешифратора, выходы блоков элементов И первой группы через блок элементов ИЛИ соединены с синхронизирующими входами дешифраторов кодов операций соответственно, операционные выходы второго регистра микрокоманд соединены с первыми входами блоков элементов И второй груп- 40 пы, вторые входы которых соединены с нулевым выходом триггера управле-i ния, выходы блоков элементов И вто" рой группы соединены с первыми входами блоков элементов ИЛИ первой груп" пы, выходы которых соединены соответственно с информационными входами дешифраторов кодов операций, выходы которых подключены к выходу микроопераций устройства, дополнительно введе" ны третья группа блоков элементов И, первый, второй, третий и четвертый элементы И, первый, второй, третий, четвертый и пятый элементы ИЛИ, первый, второй и третий элементы задержки, первый, второй, третий, четвертый, пятый, шестой и седьмой одновибраторы, блок выделения максимального нанотакта, триггер формирования микротакта, причем первый вход перво" го элемента И соединен с единичным 60 выходом триггера управления, первый вход второго элемента И соединен с нулевым выходом триггера управления, вторые входы первого и второго элементов И соединены с единичным вхо- б5 дом триггера формирования микротакта и через первый одновибратор соединены с входом обнуления управляющих разрядов первого регистра микрокоманд„ адресный выход которого соединен с первым входом первой группы входов блока элементов 2И-ИЛИ, второй вход первой группы входов которого соединен с единичным выходом триггера управления, нулевой выход которого соединен,с первым входом второй группы входов блока элементов 2И-ИЛИ, вто" рой вход второй группы входов которого соединен с адресным выходом второго регистра микрокоманд, выход блока элементов 2И"ИЛИ соединен с первым информационным входом регистра адреса, второй информационный вход которого соединен с входом начального адреса устройства, третьи входы первого и второго элементов И соединены с выходом дешифратора; выходы первого и второго элементов И соединены с сйнхронизирующими входами соответственно первого и второго дешифраторов адреса и с первым и вторым входами первого элемента ИЛИ, выход которого через первый элемент задержки соединен с нулевым входом триггера формирования микротакта, единичный вход которого соединен с выходом второго элемента ИЛИ, первый вход которого соединен с выходами блоков элементов И второй группы, второй вход - с выходом блока выделения максимального нанотакта, первый вход которого соединен с выходами дешифраторов управления, вторсй вход - c выходом дешифратора, третий вход второго элемента ИЛИ соединен с входом начального адреса устройства, выход метки типа микрокоманды второго регистра микрокоманд соединен с входами второго и третьего одновибраторов, выход второго одновибратора соединен с первым входом третьего элемента

ИЛИ, выход третьего одновибратора соединен с первым входом четвертого элемента ИЛИ, выход метки типа микрокоманды первого регистра микрокоманд соединен с входами четвертого и пятого одновибраторов, выход четвертого одновибратора соединен с вторым входом четвертого элемента ИЛИ, выход пятого одновибратора соединен с вторым входом третьего элемента .

ИЛИ, выходы метки ветвления первого и второго регистров микрокоманд сое" динены с входами пятого элемента ИЛИ, выход которого соединен с первыми входами третьего и четвертого элементов И, второй вход третьего элемен" та И соединен с инверсным входом четвертого элемента И и подключен к вхо" цу логических условий устройства, выход третьего элемента И через шестой одновибратор соединен с третьим входом третьего элемента ИЛИ, выход ко1005049 торого через второй элемент задержки соединен с единичным входом триггера управления, нулевой вход которого соединен-с выходом третьего элемента .задержки, вход которого соединен с выходом третьего элемента ИЛИ, Информационные выходы первого регист" ра микрокоманд соединены с первыми входами блоков элементов И третьей группы, вторые входы которых соединены с единичным выходом триггера управле-10 ния, а выходы - с вторыми входами блоков элементов ИЛИ-группы.

Кроме того, блок выделения максимального нанотакта содержит первый .и второй элементы ИЛИ, группу (m-1) элементов И-ИЛИ (m — число нанотактов B микротакте), группу (т-1) элементов НЕ, групйу m элементов И, причем входы первого элемента ИЛИ и пер:. вые входы (m-1) элементов И-ИЛИ груп- 2О пы соединены с первым входом блока, вторые входы (m-1) элементов И-ИЛИ группы соединены с выходами (m-1) элементов НЕ-группы соответственно, выход первого. элемента ИЛИ и выходы (m-1) элементов И-ИЛИ группы соединены с первыми входами соответствующих Ш элементов И группы, вторые входы которых соединены с вторыми входом блока, выходы первого элемента

ИЛИ и (m-1) элементов И-ИЛИ группы, кроме последнего, соединены с входами соответствующих (m-1) элементов НЕ группы, выходы m элементов

И группы соединены с входами второго элемента ИЛИ, выход которого под- 35 ключен к выходу блока.

На фиг. 1 изображена схема предлагаемого микропрограммного устройства управления на фиг. 2 — функциональная схема блока выделения макси- 40 мального нанотакта.

Предлагаемое устройство содержит (фиг. 1) генератор 1 тактовых импульсов, счетчик 2, блок 3 элементов .

2и-или, вход 4 начального адреса уст-45 ройства, регистр 5 адреса, первый элемент И б, первый дешифратор 7 адреса, первый блок 8 памяти, первый регистр 9, микрокоманд, дешифратор 10, управляющие поля .11, информационные поля 12,.адресное поле 13, поле 14 метки .типа микрокоманды и поле 15 метки ветвления, первый одновибратор 16, управляющие дешифраторы 17, первую группу блоков 18 элементов И, первый блок 19 элементов ИЛИ, третью группу блоков 20 элементов И, первую группу блоков 21 элементов ИЛИ, дешифраторы 22 кодов операции, выходы

23 микроопераций Устройства, второй элемент И 24, второй дешифратор 25 6О адреса,, второй блок 26 памяти,. вто-. рой регистр 27 микрокоманд, содержащий информационные поля 28, адресное поле 29, поле 30 метки типа микрс ко" канды, поле 31 метки ветвления, 65 первый элемент ИЛИ 32, первый элемент 33 задержки, вторую группу бло . ков 34 элементов И, блок 35 выделения максимального нанотакта, второй элемент ИЛИ 36, триггер 37 формирования микротакта, пятый элемент ИЛИ

38, второй одновибратор 39, третий одновибратор 40, четвертый одновибратор 41, пятый одновибратор 42,. вход 43 логмческих условий устройства, третий элемент M 44, четвертый элемент И 45, шестой одновибратор 46, седьмой одновибратор 47, четвертый элемент ИЛИ 48, третий элемент ИЛИ

49, второй элемент 50 задержки, тре° тий элемент 51 задержки, триггер 52 управления.

Блок 35 выделения максимального нанотакта (Фиг. 2) содержит первый элемент ИЛИ 53, группу 54 (m-1) элементов И-ИЛИ (в - число нанотактов в микротакте), группу элементов НБ

55, группу 56 элементов И, второй элемент ИЛИ. 57.

Микропрограммное устройство управления работает следующим образок.

Каждый микротакт устройства состоит из нанотактов.

В исходном состоянии все элементы памяти находятся в нулевом состоянии, в регистр 5 адреса записан адрес начальной однотактной микрокоманды микропрограммы через вход 4 устройства.

Одновременно с записью адреса первой микрокоманды сигнал с входа 4 устрой-. ства через второй элемент ИЛИ 36 ус.танавливает триггер формирования так.та в единичное состояние и подготавливает второй элемент И 24 для разрешения считывания через второй дешифратор 25 адреса однотактную микроко-. манду, записанную во втором блоке 26,.

Первый тактовый. импульс, поступающий. с выхода дешифратора 10 через второй элемент И 24 на синхровход второго дешифратора 25 адреса, разрешаЕт считывание первой однотактной микракоманды из второго блока 26 во второй регистр 27 микрокоманд. В полях 28 записаны коды однотактной микрокоманды, которые. через вторую группу блоков 34 элементов И и через второй блок -21 элементов ИЛИ поступают на входы соответствующих дешифраторов

22 кодов операций. Сигналом с единичного выхода триггера 37 формирования такта через первый .одновибратор 16 управляющие поля ll первого . регистра 9 микрокоманд обнуляются.

Нулевые коды управляющих полей 11 поступают на входы управляющих де" шифраторов 17, первые выходы которых возбуждаются и через первую группу блоков 18 элементов И и первый блок 19 элементов ИЛИ поступают на синхрониэирующие входы дешифратаров

22 кодов операции, на входы которых поступают коды микрооперации первой

1005049 микрокоманды, На выходах 23 дешифраторов 22 появляются сигналы соответствующих микроопераций. После выдачи однотактной микрокоманды сигналы с выходов блока 34 элементов И посту пают на входы второго элемента ИЛИ

Зб, сигнал с выхода которого устанав" ливает триггер 37 формирования в единичное состояние, разрешая тем самым чтение очередной микрокоманды.

Кроме операционных частей в полях

28 второго регистра 27 микрокоманд в поле 29 записывается адрес следуюцей микрокоманды (однотактной или многотактной). В поле 30 метки типа микрокоманды записывается признак N, при- 15 чем

1, если следующая микрокоманда является многота;:тной;

О, если следуюцая микрокоман" да является однотактной. 20

В поле 31 метки ветвления записывается признак В, причем

1, если данная микрокоманда

В= яв. яется микрокомандой ветвления; 25

0 — в противном случае, Предположим, следуюцей микрокомандой микропрограммы является многотактная микрокоманда. Р этом случае единичный сигнал с выхода поля 30 метки 30 типа микрокоманды через третий одновибратор 40, четвертый элемент ИЛИ

48 и второй элемент 50 задержки поступает на единичный вход триггера

52 управления и перебрасывает его в 35 единичное состояние.

Второй элемент 50 задержки необходим для задержки переброса триггера

52 управления на время, необходимое для перезаписи адреса следующей мик- 40 рокоманды из адресного поля 29 второго регистра 27 микрокоманд через блок 3 элементов 2И-ИЛИ в регистр 5 адреса. Сигнал с единичного выхода триггера 52 управления через первый элемент И 6 поступает на синхронизирующий вход первого дешифратора 7, разрешая тем самым чтение чикрокоманды, записанной в первом запоминаюцем блоке 8, по адресу регистра 5. Одновременно с чтением многотактной микрокоманды сигнал с синхровхода первого дешифратора 7 адреса через первый элемент ИЛИ 32 и первый элемент 33 задержки поступает на нулевой вход триггера 37 формирования такта и пе" ребрасывает его в нулевое состояние.

Первый элемент 33 задержки необходим для осуществления возможности переписи информации из блоков 8 и 2б в регистры 9 и 27.Переброс триггера 37 формирования такта в нулевое состояние показывает,что начался очередной микротакт и запрещает считывание новой микрокоманды,записанной в.регистре 5 адреса. 65

Считанная многотактная микрокоманда записывается в первый регистр 9 микрокоманд, на информационных полях которого записаны управляюцие и операционные части микрокоманды. При этом в управляющих полях 11 записаны коды номеров нанотактов, в которых

I должна быть выполнена соответствую- . щая микрооперация, коды которых . записаны в операционных полях 12.

Код такта, .в котором должна считываться операционная информация с поля 12, поступает с поля 11 первого регистра 9 микрокоманд на управляющий дешифратор 17. Один из выходов управляющего дешифратора 17, соответствующий коду выдачи микрооперации в данноМ нанотакте возбуждается. Сигнал с выхода дешифратора 17 через элемент И первой группы блоков элементов И и элемент ИЛИ первого блока 19 элементов ИЛИ поступает на синхровход дешифратора 22. Операционная часть микроопераций данного нанотакта поступает через блок 20 элементов И и блок 21 элементов ИЛИ на вход дешифратора 22 кода операции. На выходе дешифратора 22 появляется сигнал соответствующей микрооперации. Аналогично в соответст-! вующем нанотакте производится считы" вание информации с каждого из выходов операционных полей 12 в регистры

9 микрокоманд.

Адрес очередной микрокоманды с выхода поля 13 через блок 3 элементов

2И-ИЛИ поступает на регистр 5 адреса.

Если очередная микрокоманда является многотактной, сигнал с выхода поля М метки типа микрокоманды через четвертый одновибратор 41, четвертый элемент ИЛИ 48 и второй элемент 50 задержки поступает на единичный вход триггера 52 управления. Если очередная микрокоманда является однотактной, сигнал с выхода поля М метки типа микрокоманды через пятый одновибратор 42, третий элемент ИЛИ 49 и третий элемент 51 задержки поступает на нулевой вход триггера 52 и перебрасывает его в нулевое состояние, подготавливая тем самым схему для работы с однотактной микрокомандой.

При работе устройства с многотакт" ной микрокомандой сигналы с выходов управляющих дешифраторов 17 поступают на вход блока 35 выделения максимального нанотакта. При этом на первый элемент ИЛИ 53 поступают сигналы с выходов дешифраторов 17, соответствующие кодам максимальных нанотак" тов, в которых выдаются соответствующие микрооперации. Если в многотактной микрокоманде имеется хоть одна микрооперация, выполняемая в последнем нанотакте, на соответствующем выходе управляющего дешифратора 17

1005049

10 появляется сигнал. Данный сигнал поступает на один из входов первого элемента ИЛИ 53 и после подачи тактового импульса, поступающего с дешифратора 10, проходит через элемент

И 56, второй элемент ИЛИ 57 блока 35. и через второй элемент ИЛИ 36 на единичный вход триггера 37 формирования такта, перебрасывая его в единичное состояние. Появление сигнала на .единичном выходе триггера 37 формирования такта указывает на окончание выполнения данного микротакта и разрешает через. первый элемент И 6 или второй элемент И 24 чтение очередной микрокоманды, адрес которой записан !5 в регистре 5 адреса.

Если B m-ом нанотакте нет управляющей информации, сигнал с выхода элемента НЕ 55 подготавливает для опроса первый элемент (m-1) И-ИЛИ 54,20 на который поступают сигналы с выходов управляющих дешифраторов, соот" ветствующих (m-1)-у нанотакту. (m 1)-м тактовым импульсом производится опрос данного нанотакта. Если для данного нанотакта есть управляющая информация, формируется сигнал окончания микротакта на данном нанотакте.

Если в (m-1) -м нанотакте нет управляющей информации, последовательно опрашиваются все оставшиеся нанотакты, в которых имеется управляющая информация.

Таким образом, сигнал окончания 35 микротакта формируется для максимального нанотакта, в котором имеется управляющая информация, записанная в .

- операционных полях 12 первого регист" ра 9 микрокоманд. 40

Если очередная микрокоманда (однотактная или многотактная) является микрокомандой ветвления, на соответствующем .выходе поля ветвления 15 или

31.появляется сигнал, котоРый через 45 пятый элемент ИЛИ.38 поступает на входы третьего и четвертого элементов И 44 и 45. В зависимости от признака логических условий, поступающего на вход 43 устройства, триггер

52 управления устанавливается в то или иное состояние. При этом признак логических условий формируется следующим образом:

1, если очередная микрокомаида является многотактной;

О, если очередная микрокомана является однотактной.

После этого с приходом очередно". го сигнала первого нанотакта устройство функционирует аналогично описан-60 ному.

Применение предлагаемого микро» программного устройства управления позволит повысить быстродействие по отношению к прототипу иа 20%. 65

Формула изобретения

1. Микропрограммное устройство уа" равления, содержащее регистр адреса, генератор тактовых импульсов, счетчик, дешифратор, последовательно соединенные первый дешифратор адреса, первый блок памяти и первый регистр микрокоманд, последовательно соеди» ненные второй дешифратор адреса, второй блок памяти и второй регистр микрокоманд, блок элементов ИЛИ, первую и вторую группы блоков элементов И, группу блоков элементов ИЛИ, блок элементов 2И-ИЛИ, и дешифраторов кодов операций, триггер управления, причем выход регистра адреса соединен с информационными входами первого и второго дешифраторов адреса, управляющие выходы первого регистра микрокоманд соединены с информационными входами управляющих дешифраторов, соответственно, выходы которых соединены с первыми входами блоков элементов И первой группы, вторые входы которых соединены с выходом

:дешифратора, информационнь",Ъ вход которого соединен с выходом счетчика, счетный вход которого подключен к выходу генератора тактовых импульсов и управляющему входу дешифратора, выходы блоков элементов И первой группы через блок элементов

ИЛИ подключены к синхронизирующим входам дешифраторов кодов операции соответственно, операционные выходы второго регистра микрокоманд соединены с первыми входами блоков элементов И второй группы, вторые входы которых соединены с нулевым выходом триггера управления, выходы блоков элементов И второй группы соединены с первыми входами блоков элементов

ИЛИ группы, выходы которых подключены соответственно к информационным входам дешифраторов кодов операций, выходы которых подключены к выходу микроопераций устройства, о т л ич ю щ е е с я тем, что, с целью повышения быстродействия, оно дополнительно содержит третью группу блоков элементов И, первый, второй, тре тий и четвертый элементы И, первый, второй, третий,.четвертый и пятый элементы ИЛИ, первый., второй и третий элементы задержки, первый, второй, третий, четвертый, пятый, шестой и седьмой одновибраторы, блок выделения максимального нанотакта, триггер формирования микротакта, при чем первый вход первого элемента И соединен с единичным выходом триггера управления, первый вход второго элемента И соединен с нулевым выходом триггера управления, вторые зходы первого и второго элементов И оое» динены с единичным выходом триггера формирования микротакта и через аер. 1005049

12 вый одновибратор соединены с входом обнуления управляющих разрядов пер,вого регистра микрокоманд, адресный выход которого соединен с первым входом первой группы входов блока элементов 2И-ИЛИ, второй вход первой группы входов которого соединен с единичным выходом триггера управления, нулевой выход которого соединен с первым входом второй группы входов блока элементов 2Й-ИЛИ, второй вход. 10 второй группы входов которого соединен с адресным выходом второго регистра микрокоманд, а выход - с первым информационным входом регистра адреса, второй информационный вход кото- )5 рого подключен к входу начального адреса устройства,.третьи входы первого, и второго элементов И соединены с .выходом дешифратора, выходы первого и второго элементов И соединены с синхронизирующими входами первого и второго дешифраторов адреса и с первым и в торым входами Первого элемента ИЛИ соответственно, выход первого элемента ИЛИ через первый элемент задержки соединен с нулевым входом триггера формирования микротакта, единичный вход которого соединен с выходом второго элемента

ИЛИ, первый вход которого соединен с выходами блоков элементов И второй группы, второй вход - с выходом блока выделения максимального нанотакта, первый вход которого соедииен с выходами дешифраторов управления,, вто" рой вход - с выходом дешифратора, третий вход второго элемента ИЛИ соединен с входом начального адреса уст ройства, выход метки типа микрокоман-. ды второго регистра микрокоманд соединен с входами второго и третьего 40 одновибраторов, выход второго одновибратора соединен с первым входом третьего элемента ИЛИ, выход третьего одновибратора соединен с первым входом четвертого элемента ИЛИ, вы- 45 ход метки типа микрокоманды первого регистра микрокоманд соединен с входами четвертого и пятого оцновибраторов, выход четвертого одновибратора соединен с вторым входом четвертого элемента ИЛИ, выход пятого од" новибратора соединен с вторым входом третьего элемента ИЛИ, выходы метки ветвления первого и второго регистров микрокоманд соединены с первым и вторым входами .пятого элемента ИЛИ, выход которого соединен с первыми входами третьего и четвертого элементов И, второй вход третьего элемента И соединен с инверсным входом четвертого элемента И и подключен к входу логических условий устройства, выход третьего элемента И через шестой одновибратор соединен с третьим входом третьего элемента ИЛИ, выход четвертого элемента И через седьмой одновибратор соединен с третьим входом четвертого элемента ИЛИ, выход которого через второй элемент задержки соединен с единичным входом триггера управления, нулевой вход которого соединен с выходом третьего элемента задержки, вход которого соединен с выходом третьего элемента ИЛИ, ин.формационные выходы первого регистра микрокоманд соединены с первыми входами блоков элементов И третьей группы, вторые входы которых соединены с единичным выходом триггера управления, а выходы — с вторыми входами блоков элементов ИЛИ группы.

2. Устройство по п. 1, о т л и ч а ю щ е е с я тем, что блок выделения максимального нанотакта содержит первый и второй элементы ИЛИ, группу (tn-1) элементов И-ИЛИ (щ — число нанотактов в микротакте), группу (1п-1) элементов НЕ, группу tn элементов И, причем входы первого элемента

ИЛИ и первые входы (п-1) элементов

И-ИЛИ группы соединены с первым входом блока, вторые входы (m-1) элементов И-ИЛИ соединены с выходами (щ-1)

} элементов HE группы соответственно, выход первого элемента ИЛИ и выходы (rn-1) элементов И-ИЛИ Группы соединены соответственно с первыми входами rn элементов И группы, вторые входы которых соединены с вторым входом блока, выходы первого элемента

ИЛИ и (m-1) элементов И- ИЛИ группы, кроме последнего,. соединены с входами (m-1) элементов HE группы соответственно, выходы элементов И группы соединены с входами второго элемента ИЛИ, выход которого подключен к выходу блока.

Источники информации, принятые во внимание при экспертизе

1..Авторское свидетельство СССР

Р 467351, кл. G 06 F 9/22, 1972, 2. Авторское свидетельство СССР по заявке Р 2765918/18-24, кл. G 06 F 9/22, 1970 (прототип).

1005049

1005049

Фиг.2

Составитель Л. Логачева

Редактор Л.Алексеенко Техред Е.Харитончик Корректор М.Демчик

Заказ 1900/64 Тираж 704 Подписное

ВНИИПИ Государственного комитета СССР по делам изобретений и открытий

113035, Москва, Ж-35, Раушская наб., д. 4/5

Филиал ППП Патент, г.Ужгород, ул.Проектная, 4